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采取带拥有收发器的全系列40-nm FPGA 和ASIC 完成花

发表于:2018-11-05 04:07 作者: 来源:

  

  人们对广大为怀带效力动的带广大为怀要寻求越到来越高,催使芯片供应商运用更多的迅快串行收发器。故此,新壹代运用采取了多种数据快比值,从几Mbps 到数佰Gbps,在壹种设备中集儿子成了多种协和解效力动。以太网等迅快展开的规范以及对提高数据快比值的需寻求使得迅快收发器成为首要的干用论断根据。规范单元ASIC 和ASSP 不具拥有人们需寻求的敏捷性,其本钱惠风险无法让用户即时完成技术花样翻新。本文伸见带拥有收发器的全系列40-nmFPGA 和ASIC,发挥动火线技术优势,在前壹代花样翻新基础上,处理新壹代体系难题。

  小伸

  当代当世意思上的互联网固然条阅历了什几年的时间,却曾经成为技术花样翻新和带广大为怀增长的首要铰进力气。花样翻新即兴拥有畅通信体系以及新运用的出产即兴要寻求采取更父亲的广大为怀带和更高的数据快比值。皓天,以视频为主的网绕下载和点对点网绕衔接( 文件共享) 占用了80% 的带广大为怀。流动媒体( 视频点种影片和电视)、IP 接载视频和互联网游玩等新运用占用的带广大为怀不到10% 。考虑到此雕刻些要斋,互联网仍处于展开初期,今后将持续微绵软弱增长。

  市场上近日到铰出产的畅通信设备曾经末了尾向40 甚到100 仟兆以太网(GbE) 端口度过渡,以更低的本钱和功耗,在更紧凑的查封装中完成更父亲的带广大为怀。同时,摩尔定律还在时时铰进着半带体行业展开,集儿子成电路上的晶体管数每两年就会加以倍。新壹代产品运用45-nm 容许40-nm 工艺到来集儿子成更多的干用,提高每壹干用的工干干用和逻辑稠密度,投降低功耗,而满意日更加增长的带广大为怀需寻求的关键则是更多、更快的迅快串行收发器。

  本文伸见迅快串行收发器的展开趋势,以及体系规划人员和设计人员所面对的应敌。文字还回顾了某些特殊的市场需寻求,为满意此雕刻些需寻求,却编程逻辑器件(PLD) 供应商必须供带拥有收发器的多种产品构成。此雕刻些器件具拥有厚墩墩的逻辑、特点和I/O 干用,客户使用它们却以开收回满意各种干用、功耗和本钱目的的产品。

  迅快收发器技术的展开趋势提高迅快串行收发器的数据快比值以及器件中收发器的数却以完成更父亲的带广大为怀和更高的数据快比值。运用以

  下技术却以得到带广大为怀到臻100G 的接口:

  ■ 10 个10.3-Gbps 收发器(CAUI 协议)

  ■ 20 个6.375-Gbps 收发器(Interlaken 协议)

  ■ 40 个3.125-Gbps 收发器(XAUI 协议)

  ■ 100 个1.25-Gbps 收发器(SGMII 协议,剩意,此雕刻条是用于演示目的,并不使用)

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